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Synopsys Synplify 2009.06 SP1 整合 Service Pack 1 可編程閘陣列設計 英文版會員登入 |
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Synopsys Synplify 2009.06 SP1 整合 Service Pack 1 可編程閘陣列設計 英文版
-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-= HoneRiSO Apps -=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-= 軟體名稱: Synopsys Synplify 2009.06 SP1 整合 Service Pack 1 語系版本: 英文版 光碟片數: 單片裝 保護種類: 破解檔、授權檔 破解說明: 見最底下 系統支援: Windows XP/Vista/7 硬體需求: PC 軟體類型: 可編程閘陣列設計 更新日期: 2010.02.22 軟體發行: Synopsys(A_x) 官方網站: http://www.synopsys.com/tools/implementation/fpgaimplementation/fpgasynthesis/pages/synplifypremier.aspx 中文網站: 無 軟體簡介: (以官方網站為準) -=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-= Synplicity 公司近日宣佈擴展了其 Synplify 家族FPGA 綜合工具,以滿足當今複 雜 FPGA 器件設計的需要。Synplicity 的 Synplify Premier 為 FPGA設計人員提 供了一個整合開發環境,採用該公司獨有的 FPGA 綜合技術,該軟體利用基於圖形 化的物理綜合(physical synthesis)技術和功能強大的RTL測試工具(Identify RTL Debugger),具有一鍵式物理綜合流程的功能。 Synplify Premier的核心是該公司新的基於圖形的物理綜合技術,一個自動化的單 通道設計流程能為開發人員提供先進的時序性能,可以極大地提高時序關聯性並縮 短設計週期。採用基於圖形的方法進行物理綜合,設計人員能更快地進行時序分析 ,同時可使產品性能提高 20(與單獨採用邏輯綜合相比)。 -=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-= -=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-= ‧測試環境 Windows 7 繁體中文版、Intel Core 2 Duo CPU E7400 2.80 GHz、 1 GB 記憶體、NTFS 格式 80.0Gb 硬碟。 ‧執行光碟『安裝錄影教學.exe』檔案 -=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=
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